FPGA课程 
FPGA线上就业班
课程小结 100+
课程时长 100天
课程介绍：
1、培养目标：FPGA逻辑开发工程师，FPGA应用开发工程师，FPGA硬件设计工程师等；
2、课程学时：100天 ；
3、人数限制：30人 ；
4、就业薪资：新入职8K-15K；
5、招生对象：0零基础学习（理工科类相关专业）；
6、推荐就业：就业推荐协议（薪资7K+）；
项目实战：
采用赛灵思原厂+自主研发拓展板；
1、基于ZYNQ7000的虚拟示波器；
2、基于AI的图像识别系统；
3、实时图像处理及存储系统；
项目包括：（DDS信号发生器（纯verilog）、虚拟示波器（纯verilog）、以太网视频传输（纯verilog）、UBS3.0视频图像传输（纯verilog）、运动目标检测（纯verilog）、图像存储系统（纯verilog）、PCIE视频图像传输（纯verilog）、光纤视频图像传输（纯verilog））
课程大纲：
讲师介绍：
周老师：
中国地质大学（武汉），通信工程学士学位，中国科学院大学，硕博连读，工学博士学位，德国重离子研究中心（GSI），FAIR 数据获取，博士后，研究方向：数据获取、电子学、工业测控、层析成像等；
陈老师：
电子科技大学通信学院 博士后，电子科技大学 电子工程学院 电磁场与微波技术 工学博士；四川大学 电子信息学院 无线电物理 理学硕士，研究方向：射频、FPGA高性能计算等；
王老师：
本科毕业于电子科技大学（集成电路设计与集成系统专业），硕士毕业于美国特拉华大学，博士毕业于澳大利亚新南威尔士大学，研究方向：集成电路、光伏等；
课程安排：
授课：全天答疑、录播 + 直播结合（录播基础，直播设计与调试）；
直播时间：周二 + 周四（20:00-22:00）周六（13:00-17:00）；
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01.
就业咨询
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02.
FPGA是什么
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03.
FPGA发展史
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04.
FPGA应用场景
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05.
vivado使用（实操），FPGA开发流程
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06.
verilog基础语法（模块结构、端口、变量、常量、标识符、赋值语句）
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07.
数字电路基础（逻辑门、竞争与冒险、电平标准、触发器）
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08.
verilog进阶语法（always语句、case语句、if语句、begin end、阻塞赋值与非阻塞赋值）
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09.
查找表结构
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010.
计数器（实操）
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011.
分频器（实操）
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012.
跑马灯实验（实操）
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013.
状态机（含义、原理、状态机分类、实现方式）
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014.
状态机实现按键消抖（实操、模块化设计）
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015.
数码管（含义、显示原理、原理图连线）
时长
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016.
译码器
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017.
数码管静态显示1234（实操）
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018.
动态显示原理
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019.
数码管计数器（实操）
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020.
时长
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021.
可综合不可综合语句
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022.
仿真语法
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023.
仿真（仿真含义、仿真分类）
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024.
时序图含义
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025.
Simulation仿真教程（按键消抖）
时长
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026.
74HC595手册阅读
时长
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027.
74HC595驱动原理
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028.
点阵屏静态显示（实操）
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029.
ILA含义
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030.
vivado逻辑分析仪使用（ip core、mark debug、原理图标记）
时长
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031.
捕捉按键有效信号（实操）
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032.
时钟抖动
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033.
vivado clocking_wizard原理
时长
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034.
vivado clocking_wizard使用
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035.
序列发送器
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036.
超声波手册阅读
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037.
超声波驱动原理（接收端与发射端）
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038.
时长
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039.
uart的含义
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040.
通信方式的分类（异步通信、同步通信）
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041.
通信方向的分类（单工、半双工、全双工）
时长
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042.
通信数据分类（串行、并行）
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043.
uart通信协议（uart含义、波特率、起始位、数据位、奇偶校验位、停止位）
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044.
uart时序图讲解
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045.
状态机讲解
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046.
CH340
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047.
ram简介（ram介绍、FPGA中的ram资源介绍）
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048.
DRAM与BRAM区别
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049.
RAM时序图讲解
时长
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050.
RAM ip配置讲解
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051.
ram uart回环
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052.
模块化设计
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053.
状态机讲解
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054.
FIFO简介
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055.
FIFO应用（缓存、异步信号处理）
时长
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056.
FIFO时序讲解
时长
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057.
FIFO配置（异步FIFO，同步FIFO区别）
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058.
FIFO uart回环
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059.
模块化设计
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060.
状态机讲解
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061.
乒乓缓存简介
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062.
乒乓缓存应用
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063.
pp缓存实现方式（ram，FIFO）
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064.
状态机讲解
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065.
时长
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066.
SPI简介
时长
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067.
spi应用
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068.
物理层链接（主从连接模式、3线、4线）
时长
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069.
协议层（时钟极性、时钟相位、时序图讲解）
时长
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070.
状态机讲解（spi主机）
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071.
flash写使能指令时序图
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072.
模块化设计
时长
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073.
状态机讲解
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074.
flash写操作时序图
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075.
模块化设计
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076.
flash读操作时序图
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077.
模块化设计
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078.
状态机讲解
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079.
IIC简介
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080.
IIC应用
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081.
IIC物理层链接（主从连接模式、上拉电阻）
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082.
IIC协议层
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083.
IIC时序图讲解（主机）
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084.
状态机讲解
时长
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085.
EEPROM简介（rom，prom，eprom，eeprom）
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086.
EEPROM应用
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087.
EEPROM手册阅读
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088.
EEPROM读写数据时序
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089.
模块化设计
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090.
状态机讲解
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091.
时长
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092.
HDMI简介
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093.
HDMI应用
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094.
HDMI物理层链接
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095.
HDMI接口设计原理（VGA TO HDMI）
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096.
TDMS算法编码讲解
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097.
流水线设计
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098.
TMDS算法实现（实操）
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099.
原语介绍
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0100.
原语的应用
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0101.
OSERDESE2（并转串）介绍
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0102.
OSERDESE2讲解
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0103.
OBUFDS（差分输出）
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0104.
OBUFDS讲解
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0105.
HDMI模块化设计
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0106.
HDMI移动方块设计原理
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0107.
状态机讲解
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0108.
HDMI图片显示设计原理
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0109.
时序约束基本概念解析、IO约束和时钟周期
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0110.
约束、虚拟时钟和多周期路径约束、约束实例
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0111.
时长
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0112.
DDR简介
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0113.
DDR存储原理
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0114.
MIG接口简介
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0115.
MIG接口历程讲解
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0116.
MIG控制器时序
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0117.
MIG控制器编写
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0118.
MIG控制器仿真
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0119.
MIG控制器调试
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0120.
时长
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0121.
以太网基础
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0122.
MAC控制器简介
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0123.
RGMII接口时序
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0124.
原语介绍
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0125.
RGMII接口实现
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0126.
以太网数据包
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0127.
arp协议简介
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0128.
arp数据包分析
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0129.
arp数据包实现
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0130.
上位机调试抓包
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0131.
arp调试
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0132.
UDP简介
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0133.
UDP数据包分析
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0134.
UDP数据包实现
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0135.
ICMP简介
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0136.
ICMP数据包分析
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0137.
ICMP实现
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0138.
三速以太网测试
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0139.
时长
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0140.
通用串行总线接口，支持高速数据传输，用于连接外部设备
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0141.
USB简介
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0142.
USB数据包
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0143.
USB令牌包
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0144.
USB实现方式介绍
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0145.
USB核心芯片介绍
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0146.
USB时序讲解
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0147.
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0148.
简介
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0149.
VS2015安装
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0150.
WIN10SDK安装
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0151.
PCIE驱动编译
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0152.
QT安装
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0153.
XDMA简介
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0154.
XDMA配置
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0155.
PCIE读写例程测试
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0156.
控制卡介绍
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0157.
系统框架介绍
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0158.
FPGA代码编写
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0159.
数据卡介绍
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0160.
系统框架介绍
时长
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0161.
PCIE数据卡DDR3缓存实验
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0162.
PCIE视频图像采集原理
时长
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0163.
系统框架介绍
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0164.
时长
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0165.
SFP接口介绍
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0166.
SFP接口测试
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0167.
IBERT简介
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0168.
IBERT简介设计
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0169.
GTP 基本结构
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0170.
GTP 发送和接收处理流程
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0171.
GTP 的参考时钟
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0172.
GTP 发送接口
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0173.
GTP 接收接口
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0174.
GTP IP核调用和使用
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0175.
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0176.
C语言数据类型及运算式、基本语法、函数、预处理命令、数组、指针、结构体、链表、输入输出
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0177.
GPIO简介
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0178.
GPIO寄存器
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0179.
GPIO例程讲解
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0180.
点亮EMIO端口LED、EMIO中断、MIO中 断
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0181.
AXI_GPIO介绍
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0182.
AXI_GPIO控制原理
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0183.
时长
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0184.
中断原理、PL端按键中断
时长
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